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i2c 协议

一 .  技术性能 :      工作速率有 100K 和 400K 两种；      支持多机通讯；      支持多主控模块，但同一时刻只允许有一个主控；             由数据线 SDA 和时钟 SCL 构成的串行总线；      每个电路和模块都有唯一的地址；                           每个器件可以使用独立电源 二 .  基本工作原理 :      以启动信号 START 来掌管总线，以停止信号 STOP 来释放总线；      每次通讯以 START 开始，以 STOP 结束；      启动信号 START 后紧接着发送一个地址字节，其中 7 位为被控器件的地址码，一位为读 / 写控制位 R/W,R. /W 位为 0 表示由主控向被控器件写数据， R/W 为 1 表示由主控向被控器件读数据；      当被控器件检测到收到的地址与自己的地址相同时，在第 9 个时钟期间反馈应答信号；      每个数据字节在传送时都是高位 (MSB) 在前； 写通讯过程 :     1.  主控在检测到总线空闲的状况下，首先发送一个 START 信号掌管总线；     2.  发送一个地址字节 ( 包括 7 位地址码和一位 R/W) ；     3.  当被控器件检测到主控发送的地址与自己的地址相同时发送一个应答信号...
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802.11协议用到的简写

ACK (acknowledgment)　应答 AID (association identifier)　关联识别码　　 AP (accss point)　访问点 ATIM (announceent traffic indication message)　广播传输指示消息　　　 BSA (basic service area)　基本服务区 BSS (basic service set)　基本服务集 BSSID (basic service set identification)　基本服务集识别码 CCA (clera channel assessment)　干净信道评价 CCK (complemenetary code keying)　补码键控 CF (contention free)　无竞争 CFP (contention-free period)　无竞争期 CID (connection identifier)　连接标识符 CP (contention period)　竞争期 CRC (cyclic redundancy code)　循环冗余码 CS (carrier serse)　载波侦听 CTS (clear to send)　允许发送 CW (contention window)　竞争窗口 DA (destination address)　目的地址 DBPSK (differential binary phase shift keying)　差分二进制相移键控 DCE (data communication equipment)　数据通信设备 DCF (distributed coordination function)　分布式协调功能 DCLA (direct current level adjustment)　直接电平调整 DIFS (distributed (coordination function)interframe space)　分布式（协调功能）帧间间隔 DLL (data link layer)　数据链路层 DP (desensitization)　减敏现象 DQPSK (differential quadrature phase shift keying)　差分正交相移键控 DS (ditribution system)　分发系统 DS...
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mips 精确异常和延时槽

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一、非精确异常 在多发射乱序执行的流水线 CPU 上，从指令进入流水线到异常事件的发生，期间要经过若干流水级，此时 PC 的值已指向其后的某条指令，在实现非精确异常的 CPU 上就把此时的 PC 值作为引起异常指令的所在（为了表达的方便，记为 eptr）。 简单地说 就是 eptr 的指向，并非真正的引起异常的指令之所在，而是其后面的某条指令所在。 二、精确异常 简单地说就是 eptr 的指向就是真正引起异常的指令之所在 而实现精确异常的 CPU，则在最后指令提交时 (commit) 按指令流的顺序提交，异常的产生也在该指令提交时，这样就能精确计算出引起异常的指令相对于当前 PC 的偏移，从而保证精确异常。 也就是说当异常产生时，之前的预备工作（即取指，译码，当然PC随之增长）便被废弃。CPU从异常中返回时，再重新做读取和译码的工作。 总之，不管是何类异常，eptr 之前的所有指令都会被执行完成 (commit之后)，eptr 之后的指令不会被执行。 三、mips 延迟槽 引入延时槽主要目的就是提高流水线的效率，分为以下两种： 1、分支延时槽 分支延迟槽 (Branch delay slot)，简单地说就是位于分支指令后面的一条指令，不管分支发生与否其总是被执行，而且通过下面的图可以看出位于分支延迟槽中的指令先于目标指令提交 (commit即执行)。 ....... ....... jal 48 <---- 48 代表跳转的目标地址 jal会置ra寄存器的值 nop / li a1, 4 <---- 这地方就是一个延迟槽  ....... <----- ra 寄存器的值变为这个地方的地址 ....... 进一步理解： 流水线中，分支指令执行时因为确定下一条指令的目标地址（紧随其后 or 跳转目标处？）一般要到第 2 步以后，在目标确定前流水线的取指级是不能工作的，即整个流水线就“浪费”（阻塞）了一个时间片，为了利用这个时间片，在体系结构的层面上规定跳转指令后面的一个时间片为分支延迟槽（branch delay slot）。位于分支延迟槽中的指令总是被执行，与分支发生与否没有关系。这样就有效利用了一个时间片，消除了流水线的一个“气泡”。 如下图所示，当我们把延时槽的指令去掉以后，你会发现我们浪费了一个时钟周期。（还需要注意一点就是通过ALU一...
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